数字信号处理【西安电子科技大学出版社】ppt课件.ppt
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1、 电子技术课程设计 一. 意义、要求 综合运用电子技术课程所学知识 ,设计、安装、调试具体的电子线路 ,写出设计报告。初步了解工程设计 实践的一般过程、步骤,初步掌握其 一般技能。 1 二. 考核形式 根据设计过程中各方面情况评定成绩: 优、良、中、及格、不及格。 三. 时间安排 1.设计(介绍方案,画系统图、连线图) 2.组装、调试(约3天) 3.总结报告 四. 方案介绍 2 5.7 数字电子钟计时系统 一.设计任务和基本要求 用中、小模集成路 一台能示、分、秒的数 字子,基本要求如下: 采用LED显示累计时间“时”、“分”、“秒”。 具有校时功能。 具有整点报时功能。 二.设计方案 数字钟
2、(石英钟)走时准确、价格低廉、方便实用。 组成:振荡器、分频器、计数器、译码器、显示器 3 译 码 时计数/24进制 译 码 分计数/60进制 译 码 秒计数/60进制 晶体振荡器 分频器 校时电路 分信号时信号 时、分、秒 计数 译码、显示 秒信号产生 校时 秒信号 (1Hz) 32768Hz 4 1.秒信号发生器 产生标准秒信号,信号的稳定性、精度直接决定着数字 钟的准确度。 1Hz 14级2分频 D CP Q Q CD4060 CD4013 2Hz32768Hz 1MW 10KW 100pf 100pf 32768Hz 1011812 3 CP1 CP0 GNDCr Q13 215 石英
3、晶体振荡器 214分频2分频 秒信号 +VDD 16 5 说明: Q4 Q1310个输出端 Q13214分频 Q12213分频 Cr清零端(高电平有效) RS DCPQn+1 0000 0011 100 011 QQ SR D CP CD406014级串行二进制 计数器/分频器和振荡器 VDD 16 15 Q10Q8 14 13 Q9 12 11109 CrCP1CP0CP0 12 Q11 345678 CD4060 Q12Q13Q6Q5Q7Q4 GND VDD 14 2Q 2Q 1312 2CP 111098 2R 2D 2S 12 1Q 34567 CD4013 1Q 1CP 1R 1D
4、1S GND CD4013双D主从触发器 6 2.秒、分、时计数器 进行秒、分、时的计时,由两个60进制和一个24进制计 数器构成。 CD4029二/十、加/减、可预制的CMOS计数器 VDD 16 15 CP Q2 1413 J2 1211109 J1Q1B/DU/D 12 PE 345678 CD4029 Q3J3J0 CI Q0 CO GND 不能计数1CI 允许计数0进位输入 允许置数1PE 不能置数0预置 加法1U/D 减法0加/减 二进制计数1B/D 十进制计数0二进制/十进制 功能状态输入 管脚图见电子电路实验 与虚拟技术P 230 7 0 0 0 0 1 0 0 0 0 1 0
5、 0 1 1 0 0 0 0 1 0 1 0 1 0 0 1 1 0 1 1 1 0 0 0 0 1 1 0 0 1 0 0 0 0 CO CD4029时序图(十进制加法) 8 (1)秒、分计数器60进制 CD4029 Q3Q2Q1 Q0 B/D U/D PEJ3 J0 CO CI CP 5V CD4029 Q3Q2Q1 Q0 B/D U/D PEJ3 J0 CO CI CP 5V 秒脉冲 分脉冲 0 1 1 0 0 0 0 0 CD4081 同步级联 9 (2)时计数器24进制 CD4029 Q3Q2Q1 Q0 B/D U/D PEJ3 J0 CO CI CP 5V CD4029 Q3Q2Q
6、1 Q0 B/D U/D PEJ3 J0 CO CI CP 5V 时脉冲 0 0 1 0 0 1 0 0 CD4081 异步级联 CD4081四2输入端与门 VDD 1413 12111098 1234567 GND 管脚图见 电子电路实验与虚拟技术附录 10 3.译码显示电路 译码将计数器的8421码转变为显示控制信号。 显示显示计时情况。 LED共阳显示器 COM a bcdef g DP 360W a bcdef g 译码器 D C B A Q3Q2Q1 Q0 5V 360W 11 74LS47BCD 7段译码器/驱动器 是一种与共阳极数字显示器配合使用的集成译码器。 输出低电平有效。
7、管脚图见电子电路实验与虚拟技术附录,功能表 见数字教材译码器7448。 4.校时电路 秒等待校时; 分、时加速校时。 12 24进制计数器 (时) 60进制计数器 (分) 60进制计数器 (秒) 5V 5V5V 10KW 10KW 10KW 秒信号 (1Hz) 秒信号 分信号时信号 CPCPCP K3K2 K1 CD4011 CD4011管脚图见电子电路实验与虚拟技术附录 13 要求: 1. 画出数字钟电路的系统图(将图5.7.2、 5.7.3、5.7.4、5.7.5、5.7.6综合画在一张图中 )。 2. 画出数字钟各个组成部分的连线图(重 复部分可以省略)。 (每组一份) 14 五.组装、
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